Processador Nios II – Introdução

O Nios II é um processador softcore de 32 bits de arquitetura Harvard com conjunto de instruções reduzidas (RISC) desenvolvida pela Altera. O processador é um sistema em hardware embarcado unindo o poder do software e hardware ao mesmo tempo.

O Nios II é baseado em lógica programável em FPGA através do software Quartus II e o software Qsys/SOPC Builder. A figura a seguir ilustra a arquitetura interna de hardware do processador com  a unidade do núcleo (core), as memórias (SDRAM, SRAM, Flash), interfaces de comunicação e interfaces de entradas e saídas.

niosii
Sistema do Processador Nios II.

A seguir estão listadas algumas características do Nios II:

  • Set de instruções de 32 bits;
  • Registros de propósito geral de 32 bits;
  • Fontes de 32 interrupções;
  • Memory Management Unit (MMU);
  • Memory Protection Unit (MPU);
  • Debug através do JTAG
  • Memória no chip (On-Chip Memory);
  • Frequência até 200MHz.

O processador Nios II é equivalente a um microcontrolador que inclui uma combinação de periféricos e memórias em um único chip. O ambiente de desenvolvimento é baseado no GNU C/C++ e o Software Build Tools (SBT) para Eclipse.

O QSYS é um GUI (Graphical User Interface) que habilita as configurações do Nios II, tais como números de periféricos e memórias, espaçamento de endereços, controladores de Ethernet, UART, etc. Após criá-lo é gerado um arquivo HDL que deverá ser instanciado no Top Level de seu projeto.

Estarei demonstrando no próximo post como criar um projeto em FPGA utilizando o processador Nios II.

Até mais!

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5 comentários sobre “Processador Nios II – Introdução

  1. Pingback: Processador Nios II – Desenvolvimento: Parte I | AGE TECHNOLOGY

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